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lifaung
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加入日期: Aug 2001
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引用:
作者GCVincent
1.5-10ms,google 第一條,是翻譯文章,原文來自reviewgeek


2.


當然,也許他們是唬爛的?!沒有看到引用實驗數據。


如果走錄音介面進來有可能(外面類比數位轉換就有配置fifo, 可能還要做傅立葉轉換, 這是有可能的)
原生的數位撥放不可能
即便是pi應該都是非常低的延遲

但是某些作業系統會把Vsync當作所有事件的同步器(Android會)
這樣的話這個delay到一個frame是可能的(16ms in 60Hz, 8ms @120Hz)

你舉的第二個項目就是我說的錄音介面進來....
這個轉換到20-40ms很正常.... 如果你肯自己coding FPGA, 要降低到低於數百T也是很簡單
(1000T肯定是不會到ms等級的)
     
      
舊 2021-07-22, 03:40 PM #11
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